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信號完整性

信號完整性(SI)分析集中在發(fā)射機、參考時鐘、信道和接收機在誤碼率(BER)方面的性能。電源完整性(PI)側(cè)重于電源分配網(wǎng)絡(luò) (PDN) 提供恒定、干凈的電源和低阻抗返回路徑的技術(shù)。SI和PI具有廣泛的相互依賴性。PDN會引起噪聲和抖動。電路設(shè)計和元件-- 芯片封裝、引腳、導(dǎo)線、過孔、連接器--會影響PDN的阻抗，從而影響供電質(zhì)量。

我們知道，從電源引入噪聲和抖動會導(dǎo)致高速串行網(wǎng)絡(luò)中的誤碼率，至少會降低嵌入式系統(tǒng)的效率。在最壞的情況下，可能會導(dǎo)致在關(guān)鍵任務(wù)環(huán)境中出現(xiàn)錯誤比特或錯誤的數(shù)據(jù)。

電源完整性

電源完整性不僅僅是將電壓保持在適當(dāng)?shù)姆秶鷥?nèi)。電源完整性是保證應(yīng)用于電路或設(shè)備的電源適合電路或設(shè)備的預(yù)期性能。其目的是保持從供電到耗電的電能質(zhì)量。實現(xiàn)可接受的電源完整性意味著噪聲水平在規(guī)定的允許范圍內(nèi)。

隨著電氣元件被要求在更小的電路板上執(zhí)行更多的功能，這一點變得越來越重要。隨著尺寸的不斷縮小和復(fù)雜性的增加，嵌入式系統(tǒng)越來越接近電源輸送路徑或電源完整性組件。

濾掉AC-DC電源轉(zhuǎn)換中的紋波

在這里，設(shè)計人員需要最佳的電源質(zhì)量，確保包含的任何一種開關(guān)紋波都不會被漏到下游--同時保持高效率。設(shè)計人員必須確保高效率/低噪聲的直流轉(zhuǎn)換，為整個電源分配網(wǎng)絡(luò) (PDN)供電，確保電源噪聲 (PSN)保持在最低限度。

DC-DC電源轉(zhuǎn)換

在電源的這一階段，設(shè)計人員要向最后級或負載點 (POL) 元件提供電源。其中最敏感的電源包括高速ADC轉(zhuǎn)換器、FPGA內(nèi)核和數(shù)字信號處理器（DSP）的電源。一個嵌入式設(shè)計可能會有1000多個電壓和接地平面，以便在元件間傳遞功率。處理不同電壓水平下的不同負載也是一個挑戰(zhàn)。

測量系統(tǒng)對結(jié)果的影響